Répertoire des expertises
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Intérêts de recherche et affiliations

Intérêts de recherche
  • Systèmes numériques
  • Synthèse à haut niveau
  • Systèmes temps-réel
  • Systèmes embarqués
  • Systèmes de contrôle
  • Systèmes cyber-physiques
  • Sécurite des systèmes cyber-physiques
  • Arithmétique des ordinateurs
  • Calcul haute performance
  • Architecture des ordinateurs
  • Architectures spécialisées
  • Circuits intégrés programmables (FPGA)
Type(s) d'expertises (sujets CRSNG)
  • 2514 Traitement des signaux numériques
  • 2701 Matériel informatique
  • 2702 Organisation des systèmes informatiques
  • 2704 Traitement réparti et simultané
  • 2719 Architecture d'ordinateur et conception
  • 2722 Systèmes intégrés à très grande échelle (VLSI)

Publications

Publications récentes
Article de revue
Ould-Bachir, T., Chalangar, H., Sheshyekani, K. & Mahseredjian, J. (2021). High performance computing engines for the FPGA-based simulation of the ULM. Electric Power Systems Research, 190, 7 pages. Tiré de https://doi.org/10.1016/j.epsr.2020.106716
Article de revue
Montaño, F., Ould-Bachir, T. & David, J.P. (2020). A Latency-Insensitive Design Approach to Programmable FPGA-Based Real-Time Simulators. Electronics, 9(11), 21 pages. Tiré de https://doi.org/10.3390/electronics9111838
Article de revue
Chalangar, H., Ould-Bachir, T., Sheshyekani, K., Li, S. & Mahseredjian, J. (2020). Evaluation of a Constant Parameter Line-based TWFL Real-Time Testbed. IEEE Transactions on Power Delivery, 35(2), 1010-1019. Tiré de https://doi.org/10.1109/TPWRD.2019.2933984
Communication de conférence
Montano, F., Ould-Bachir, T., Mahseredjian, J. & David, J.P. (2019). A Low-Latency Reconfigurable Multistage Interconnection Network. Communication présentée à IEEE Canadian Conference of Electrical and Computer Engineering (CCECE 2019), Edmonton, AB, Canada (4 pages). Tiré de https://doi.org/10.1109/CCECE.2019.8861540

Biographie

Tarek Ould-Bachir détient une M.Sc.A. et un Ph.D. en génie électrique de Polytechnique Montréal, obtenus respectivement en 2008 et 2013. De2007 à 2018, il a occupé divers postes au département de Recherche et développement de la compagnie OPAL-RT Technologies. De 2018 à 2020, il a été associé de recherche à Polytechnique Montréal. Il est présentement professeur adjoint au Département de génie informatique et génie logiciel de Polytechnique Montréal.

Enseignement

  • ELE1300, Circuits logiques
  • INF1600, Architecture des micro-ordinateurs
  • INF2010, Algorithmes et structures de données
  • INF3500, Conception et réalisation de systèmes numériques
  • INF3610, Systèmes embarqués

Encadrement à Polytechnique

EN COURS

  • Doctorat (4)

    • Allabadi, Ahmad. Méthodes numériques robustes pour la simulation des transitoires dans les convertisseurs de puissance.
    • Chalangar, Hossein. Simulation en temps réel de convertisseurs rapides sur FPGA.
    • Masoom, Alireza. Simulation des transitoires de réseau électrique dans des environnements de haut niveau .
    • Montano, Federico. Méthodologie de conception de simulation temps réel sur FPGA.
  • Maîtrise recherche (6)

    • Dourid, Issam. Contrôle embarqué d'un système micro-ondes pour des applications de pyrolyse.
    • Najam, Mouad. Mesure de la température dans un réacteur de pyrolyse.
    • Mashreghi Moghadam, Parisa. Architecture de recouvrement pour un parseur de paquets programmable en P4.
    • Ould Mohamed, Nassim. Contrôle .
    • Makhroute, El Mahdi . Conception et implémentation de la qualité de service de l'AGF pour le réseau fixe de la 5G.
    • El Harti, Mohamed Ayoub. Conception et implémentation d'une solution AGF programmable par P4 sur plateforme hétérogène.
  • Baccalauréat (4)

    • Soussou, Skander. Conversion de programmes P4 en matériel.
    • Gallay, Andy. Description d'architectures insensibles à la latence au moyen du langage Chisel.
    • Boucher-Charest, Benjamin. Implémentation de simulateurs de circuits d'électroniques de puissance sur FPGA au moyen du langage Chisel.
    • Zeghaida, Aymen-Alaeddine. Accélération de la librairie MSEMT au moyen de Dynawo.